反应显微谱仪的飞行时间测量 暨数据获取系统的研究
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反应显微谱仪的飞行时间测量 暨数据获取系统的研究. 周家稳. 中科院核探测技术与核电子学重点实验室 中国 科学技术大学 近代物理系. 2010 年 8 月 17 日. 报告内容. 反应显微谱仪系统简介. 设计指标及要求. TOF &DATA ACQ 系统框架. 系统各模块设计. 测试及结果. 结束语. 反应显微谱仪系统简介. 设计指标及要求. 1. 时钟模块产生时钟 jitterTRANSCRIPT
快电子学实验室 Fast Electronics Lab
中国科学技术大学University of Sci.& Tech. of China
反应显微谱仪的飞行时间测量暨数据获取系统的研究
2010 年 8 月 17 日
中科院核探测技术与核电子学重点实验室中国科学技术大学 近代物理系
周家稳
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报告内容 反应显微谱仪系统简介
TOF &DATA ACQ 系统框架 系统各模块设计 测试及结果 结束语
设计指标及要求
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反应显微谱仪系统简介
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• 1. 时钟模块产生时钟 jitter<20ps• 2. 时间测量精度好于 25ps• 3. 死时间 <10ns• 4. 数据传输率达到 20MB/s
设计指标及要求
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TOF &DATA ACQ 系统框架
TOFModule
1
TOFModule
2
TOFModule
3
TOFModule
4
Trigger fromCFDTrigger
CLKT r i g g e rC L K
T r i g g e r
C L K
TriggerCLK
PCI BUS
CLK-TrigModule
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• 一)时间测量模块系统各模块设计 - 时间测量模块设计
LMH7322
LMH7322HPTDC FPGA
SDRAMPXI J2
PXI J1
LVDS CLK
TriggerHi t signal
Hi t signal
LVDS CLK
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系统各模块设计 - 时间测量模块设计实物图:
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二) HPTDC 芯片技术及应用– Designed by CERN– With a commercial CMOS 0.25um
technology– 4 measuring resolution modes– Very high resolution better than 25ps– Applied in
BESIII , ALICE , STAR 。
系统各模块设计 - 时间测量模块设计
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三) FPGA 模块– 1.HPTDC 芯片数据读出控制模块– 2.HPRDC 芯片数据修正模块(查找表)– 3.SDRAM 缓冲控制模块– 4.PCI 接口及传输控制模块
系统各模块设计 - 时间测量模块设计
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LUT RAM
PCI
Interface
ReadoutFIFO
SDRAM
CompensationLogic FIFO
SDRAM Control Logi c
ReadControlLogicHPTDC
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四) PXI 总线应用设计系统各模块设计 - 时间测量模块设计
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• 1. 为减小环境温度变化对时钟性能的影响,使用了温度补偿晶振• 2. 使用时钟扇出芯片扇出多路时钟给各测量板• 3. 使用了多路扇出模块同步扇出各路触发信号• 4. 使用 FPGA 设计 PXI 接口,用于配置控制寄存器和扇出触发信号。
系统各模块设计 - 时钟触发模块设计
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• 1. 码密度法 INL 测试• 2. 延迟线法测试测量精度
测试及结果
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INL 测试
Random pulse
TOF Module
PXI J1
PXI J2
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测量精度测试
Delay A
Delay B
Signal sourceTektronix AFG 3251
Channel B
Channel A
Spl i tter
PXI J2
PXI J1
TOF Module
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测量精度测试
Number of hit
Ti meps
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现 场 测 试
The readout SYSTEM
The discriminator
system
The COLTRIMSSYSTEM
P S D
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初步实验结果
Ar+Ar2+Ar3+
Ar4+
psTi me of fl i ght
Hits
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