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1/16 Cadence OrCAD 系列 V16.0 新增功能】 Cadence OrCAD Capture V16.0 新增功能 .零件及图标对象可分别定义其摆放、搬移动作是否置于格点上 可于OrCAD环境中之Grid Display分别设定零件、图标对象在线路图纸中进行搬移及摆放动作时, 是否将其置于格点上。当进行此动作后软件自动将其存入Capture.ini环境中,下次开启软件亦有相同设定, 使用上可更加便利。 Connectivity Elements零件、符号对象 Connectivity Elements批注文字、图片、无电器性线段及图形图案 当勾选于Master上表示以Pointer snap to grid选项为准,其中: 勾选Pointer snap to grid则为coarse动作选项(相当于图纸快捷工具栏中 情况) 不勾Pointer snap to grid则为Fine动作选项(相当于图纸快捷工具栏中 情况); 若勾选于Coarse上表示其进行搬移及摆放动作时必落于大格点中,不受限于Master选项。 而勾选于Fine上表示其进行搬移及摆放动作时落于分割等份之小格点中。 建议使用者于摆放零件或符号对象时可将选项勾于Coarse上当零件脚位于格点上时则利于连接电器线。

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Page 1: Cadence OrCAD 系列 V16.0 新增功能】 · 2/16 .收集PSpice 模型参数文件至压缩档案中 在pspice16.0版的模型零件压缩机制可分三种模式及记录不同阶的仿真设定

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【Cadence OrCAD 系列 V16.0 新增功能】 ◆ Cadence OrCAD Capture V16.0 新增功能 .零件及图标对象可分别定义其摆放、搬移动作是否置于格点上

可于OrCAD环境中之Grid Display分别设定零件、图标对象在线路图纸中进行搬移及摆放动作时,

是否将其置于格点上。当进行此动作后软件自动将其存入Capture.ini环境中,下次开启软件亦有相同设定,

使用上可更加便利。

Connectivity Elements:零件、符号对象

Connectivity Elements:批注文字、图片、无电器性线段及图形图案

当勾选于Master上表示以Pointer snap to grid选项为准,其中:

勾选Pointer snap to grid则为coarse动作选项(相当于图纸快捷工具栏中 情况)

不勾Pointer snap to grid则为Fine动作选项(相当于图纸快捷工具栏中 情况);

若勾选于Coarse上表示其进行搬移及摆放动作时必落于大格点中,不受限于Master选项。

而勾选于Fine上表示其进行搬移及摆放动作时落于分割等份之小格点中。

建议使用者于摆放零件或符号对象时可将选项勾于Coarse上当零件脚位于格点上时则利于连接电器线。

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.收集PSpice 模型参数文件至压缩档案中

在pspice16.0版的模型零件压缩机制可分三种模式及记录不同阶的仿真设定

_ Profile模式 压缩profile相关的模型零件到 .\<library_name>.lib.

例如, profile AC 应用到 diode.lib , 会把diode.lib复制到 AC路径下,并会将设定改为.\diode.lib.

_ Design模式 压缩Design相关的模型零件到 .\<design_namepspicefiles>\<design_name>\<library_name>.lib

中.例如叫histo 的design 应用到bipolar.lib, 会把此零件库复制到 histopspicefiles\histo 的路径下,并会将设定修

改成: .\histopspicefiles\histo\ bipolar.lib.

global模式 压缩后之PSpice 模型参数文件其名称将与电路图名称相同(design_name.lib)并会将其加入模拟

设定文件中。

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.修正之PCRs

PCR No. Description 746240 OrCAD Capture in some scenarios does not close the schematic page when the design is

closed. 897889 The Library Correction Utility (Accessories LibCorrectionUtil - Library Verification /

Correction command) displays a message “missing pin number” for a part, which does not

exist in the library. 2378400 Annotate the design that contains reused blocks using the PCB Editor Reuse tab and then

create a netlist. Now, when the changes are backannotated to the existing board, a number

of nets are ripped up. 2378912 Design crashes while exporting flatnet properties. 911723, 908151 Improve the AL0036 error message. 2359752 Changes made to a user-defined property on a particular schematic is not getting updated

in all other schematic pages. 688053, 904342 Improve the ALG0037 error message 758672 Changing pin number on a particular design and then running DRC displays a system error

message. 2374272 Using Replace Cache on a design, changes the design mode from Instance to Occurrence.

896309 Improve the EXP0003 error message. 797361 In OrCAD Capture, when there is an external reference design, the occurrence properties

get reset as soon as the hierarchical pin is moved on the top block. 2368510 Unable to generate netlist after backannotating the design. 4011752 Design crashes and reports an unrecoverable exception while annotation. 2402284 Opening a particular design causes Capture to crash with an "Exception Access Violation"

error. 863513 On a particular OrCAD Capture design, copying parts from one schematic page and

pasting it on another schematic page does not work properly and displays the error

message “The parameter is incorrect”. 2400307 If Allegro PCB Editor is open in background, doubleclicking a .dsn file in Windows Explorer

opens OrCAD Capture instead of Allegro Design Entry CIS.

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◆ Cadence OrCAD Capture CIS V16.0 新增功能

.增加在CIS BOM表中可附加mechanical机械料件与assemblies组合件的功能

在以前的电路图零件中,很难去定义机械料mechanical与组合件 assemblies的使用;在输出Standard CIS BOM

也无法帮助您计算其成本以减少错误的发生的次数。现在Capture CIS 16.0,你可以产生标准的CIS Bill of Materials

中增加mechanical 与 assemblies用量在电子零件上。

然而,你要有完整的设定,在你使用这个功能之前,如下:

在你的数据库中描写关于mechanical 零件与 assemblies如何应用在电路图上。其中要包含part number,

part type, and mechanical part description等等的描述。

新增一个数据表在你的数据库中,它会连结所有的电子零件与mechanical 零件与 assemblies的描述。

新增一个更新过的CIS Configuration档案,然后CIS就正确的使用新的设定。

如果要知道更多关于设定mechanical零件与assemblies的功能,请参考OrCAD Component Information System

User’s Guide.

上述的说明设定完成后,你可以使用Bill of materials 输出对话盒来产生新的BOM表,它里面就会包含电子零件中

的mechanical 零件与 assemblies。

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CIS BOM的对话盒中有新的选项,Output Mechanical Part Data,(如上图),它允许你选择只输出mechanical 零

件或要将mechanical 零件与 assemblies都包含在BOM表中,选项功能如下:

Mechanical parts only ─ 在BOM表中显示所有mechanical 零件用量。

Both Mechanical parts and assemblies ─ 显示的mechanical 零件与 assemblies组合料件在电路图上的所

有用量。

备注:你也可以在BOM variant reports得到mechanical 零件与 assemblies在电路图上的用量。

下图是CIS BOM的范例图,当中列出零件关于mechanical 零件与 assemblies的使用量。

.修正之PCRs

PCR号码 讯息 846916 Update Part Status not working properly for Allegro footprints.

903605,9035966 Need to show a tool tip about Allegro footprint library/schematic source library in CIS

Explorer.

4001368 Need to update the bench.mdb file in the samples directory from Microsoft® Access 97 to

Access 2000.

873147 If your design has more than 53 instances of a part on a schematic page, then the part

reference value for those parts does not display in the Part Reference column of the

exported Microsoft Excel sheet.

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◆ Cadence OrCAD PSpice V16.0 新增功能

.设定重启模拟时间点

在OrCAD PSpice V16.0中可于时域分析中之Save CheckPoints设定重新模拟之时间点,并可配合Restart

simulation使模拟时间起始点可依使用者选择进行仿真,让仿真长时间之设定更加便利快速。储存此些时间点之路

径预设为与仿真档案储存路径相同或亦可由使用者自定。

Simulation time interval:设定每模拟点间之间距(以秒为单位)

Real time interval: 设定每模拟点间之间距(以分钟为单位)

Time points:区距时间

Save CheckPoints窗口设定:

Restart simulation 窗口:

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.自动收敛运算功能

于模拟设定文件中之Options选单勾选Autoconvergence选项后,当仿真计算无法依预设参数值进行收敛运算时,

可依使用者自定之参数值进行运算,让模拟计算可再继续顺利进行。

.时域分析之恢复功能

使用者现在可直接于时域分析之模拟设定文件中勾选执行恢复模式于仿真中功能,作此选项设定后PSpice仿真至

使用者设定之停止时间(TSTOP)并自动暂停,此时使用者可评估是否须再进行更长时间之模拟,若欲进行,则

可修改停止模拟时间(TSTOP)或可在其修改时间后变更聚合参数进行仿真,使仿真时间可由停止点恢复仿真,

不需重头仿真节省更多的处理时间。

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. 小计算单位

PSpice仿真运算时更加有弹性,当执行仿真运算时若产生无法聚合时,则会自动更改 小计算数据单位,以让电

路可更加顺利运算达聚合目的。

.PSpice 零件模型参数可沿袭至PSpice AA

以往在PSpiceA/D中所设计完成之线路,欲在PSpice AA中进行模拟前必须先将线路图上零件做替换为PSpice AA

零件库中之零件、摆放PSpice AA参数对象。V16.0可于进行蒙地卡罗分析时勾选PSpice 零件模型参数可沿袭至

PSpice AA功能,便可将PSpiceA/D零件模型参数文件于仿真分析时藉由转网络文件方式带至PSpice AA中,不需

替换零件便可于PSpice AA中进行模拟。

如图标,原有线路图中之零件于零件参数编辑窗口中加入误差值:

可于 PSpiceA/D 中执行模拟分析:

Lbreak

L2

9.1mH

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若欲进行PSpice AA仿真前先于仿真设定文件勾选Enable PSpice AA support for Legacy选项,并执行仿真:

利用原有图文件进行之 PSpice AA 模拟分析:

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.整合功能选项接口

PSpice V16.0中可直接于波型窗口中利用鼠标右键便可选择Add Trace、Add Plot、Add Y Axis…等功能选项。

.仿真速度增快

E(Controlled Voltage Source)及G(Controlled Current Source)仿真速度改善。

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.修正之PCRs

PCR No. Description 2365125 The Stimulus Editor cannot be invoked when a VSIM part is used with the property

IMPLEMENTATION_TYPE set to PSPICE STIMULUS. 2371588 Device summary reports twice the actual number of inductors in the design. 805542 The STATE attribute has no apparent function 805564 Diode does not show any voltage for its initial current 805611 MOSFET initial conditions defined by attributes have no effect on simulation results 829667 Pin names should be marked visible for ABM parts,such as LAPLACE and LOG. 900205 Change in pin name and numbers for part BAV99 854972 Make the Cannot intialize profile error more informative 2368554 PSpice Simulation Manager crashes if toggle cursor is used. 914913 VAN errors occur when parts are created for PSpice Models 878437 Current probes on pins of analog component shows Null current though current is present 761835 Spikes are displayed in the simulation result when OPAMP OP400 is used 832797 Notes assigned to Power Pin for some parts in opto.lib needs clarity 2359592 Display Control option closes without saving settings when carriage-return is pressed 2359622 More than 140 characters in trace expressions causes PSpice to crash without any warning

893449 VNTOL affects IF condition evaluation 897067 G Device giving less than two connections Error 2364412 COM Wrapper error when Cancel is clicked in Schematic Name 847799 internal error condition when running simulation 910507 Simulation fails to converge on first run 4011751 Groups cannot be copied between tabs 828384 The default File - Export option should be to Allegro Design Entry HDL for AMS Simulator

license 877322 Enable reactivation of probes to see results in waveform 894224 Add AC probe in Probes form on the toolbar 860646 Result not same for Monte Carlo when using distribution Gauss and WC 4016857 Gaussian model within Pspice not providing expected results 854050 TWSTPAIR has no model property

2392548 Worst Case Summary report in out file reports incorrect value 890810 NOIMOD not working ocrrectly in 10.5 902891 Results of parametric and sweep and individual step runs do not match

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◆ Cadence OrCAD PCB Editor V16.0 新增功能 OrCAD PCB Editor 16.0 的新增功能与Allegro的相似,主要为以下几点

_ General Theme of Release 16.0

_ PCB Editor User Interface

_ Color and Visibility Enhancements

_ Physical and Spacing Constraint System

_ New PCB Editor Applications

_ Misc PCB Editor Enhancements

_ OrCAD Layout Translator Updates

_ Introduction of New Product Suite

其功能请参阅Allegro 相关说明

http://www.graser.com.tw/Graser_big5/new_data/pic/Allegro_16/AllegroV16_wn.pdf

功能调整

因为 Physical 和 Spacing 的规范已被并到Constraint Manager. 所以有些功能也被归属到

OrCAD PCB Design L 等级中.

_ Constraint Manager

_ Tech file support

_ Cross section Editor

_ DRC Mode Settings

_ Testability DRCs

_ All Testprep menu functions except Testprep-automatic

_ Allow Etch, T's, Pad-Pad Connect DRC

_ BB Via Stagger DRC

_ Min BB Via Gap DRC

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.修正之PCRs

PCR No. Description 900205 Change in pin name and numbers for part BAV99 53356 The height information for a component in a Layout design does not get

translated to the OrCAD PCB Editor design. 262342 In Layout, test preparation (test point) is treated as a component. However,when the

design is converted to OrCAD PCB Editor, the test preparations are converted as vias. 831655 The copper shapes in the Layout design do not get converted properly during the

conversion process. The copper shapes in the Layout design are translated as static

copper filled type shapes in OrCAD PCB Editor. 281930 The Route via keepout areas in a Layout design does not get translated to the OrCAD PCB

Editor design.

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【Cadence OrCAD V16.0 整体环境新增功能】

.Cadence辅助说明档

如下图标为Cadence® Help的主窗口,可让使用者更加方便快入查询信息,并可提供使用者自定文件并做搜寻文

件动作。

Cadence Help除了可由软件上的工具列选项进入,

亦可在尚未进入软件时选择Cadence Help进入,

或是直接于安装路径下选择cdnshelp。

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.Cadence Help加强功能

可直接于Capture Help中查询至相关Cadence产品别信息

.加注产品商标符号

于软件窗口之右上角摆放Cadence注册商标、一红线横跨于工具列下。

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【OrCAD V16.0 新产品套装】 OrCAD PCB Designer Basics

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(2)OrCAD® PCB Editor Basics:电路板设计

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网络文件。

线路图中之高速迅号属性如 RELATIVE_PROPAGATION_DELAY,RATSNEST_SCHEDULE 和

DIFFERENTIAL_PAIR将不透过网络文件带至电路板中。

于PCB Designer Basics包装中之OrCAD PCB Editor Basics软件,可做四层板,并可储存500颗以内零

件数目和2000条电器线之电路板。

OrCAD EE Designer Plus

在此产品别中包含:

(1)OrCAD® Capture:线路图设计

(2)PSpice® A/D:模拟及混合讯号电路仿真

(3)PSpice® Advanced Analysis (AA):提供 佳化仿真分析和改善电路设计。

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